本人由于换工作的原因，由ccs3.1平台下转化为ccs3.3平台。先说说本人感觉的区别，ccs3.1下的CSL库集成到DSP/BIOS内，而3.3的CSL库在DSP/BIOS下就没有体现。1.二话不说，先搭建CCS3.3的工程，添加main函数。这个比较简单就不细说了。2.创建DSP/BIOS文件。...
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2014-05-19 22:05:56
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外设访问corePac内部资源（L1，L2）时的内存保护等问题请参考下面两个blog，已经叙述的很详细。
"TI C66x DSP 系统events及其应用 - 2"，"TI C66x DSP 系统events及其应用 - 3"。...
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2014-05-18 18:24:15
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CPU访问corePac内部资源（L1，L2）时的内存保护（通过设置内存的访问权限实现）等问题请参考下面两个blog，已经叙述的很详细。
"TI C66x DSP 系统events及其应用 - 2"，"TI C66x DSP 系统events及其应用 - 3"。...
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2014-05-18 14:50:49
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前面讲到对于中断来说，eventCombiner将INTC的输入event 4~127分为四个group，即evenCombiner的四个输出event 0~3. 这样event 0~3与event 4~127一起作为Interrupt Sector的输入。之所以这样做是因为CPU仅有12个INT输入（INT4~15），而systemEvent有4~127共124个event，所以12个CPU的I...
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2014-05-18 06:12:14
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根据5.2中的讲解，当监控high priority queue的PDSP channel设定好后，那么与之对应的event就知道了（PDSP channel与event一一对应），注意5.x讲的是中断的配置，并不是exception的配置，4.x讲的是exception。
中断event与ISR配置伪代码如下,目的是使event与ISR建立联系：
/*Configure ev...
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2014-05-15 23:41:39
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偶然发现TI官网有新闻报道大奖赛，还有沈洁女士给我们颁奖的照片，纪念一下。
第六届TI DSP及嵌入式大奖赛决赛暨颁奖典礼在厦门大学成功举行
Frances
Han
2013-2014 TI DSP及嵌入式大奖赛决赛暨颁奖典礼于4月24日、25日在有着中国最美校园之称的厦门大学成功举行。本次竞赛经过8个月的激烈角逐，共有37个参赛队在全国上百个参赛队中脱颖而...
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2014-05-15 06:41:45
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对于TI C66x DSP的每个CPU有INT4~15共12个中断输入。对于中断，event combiner将event 4~127分为4个组（event 0~3为INTC内部使用，如图示为event combiner的四个输出）。类似于4.x中的exception，中断也有同样功能的event flag，event mask，masked event flag寄存器。...
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2014-05-14 23:54:21
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DSP访问外存时内存保护的问题，原因是CPU访问了自己没有访问权限的外部内存（如share memory即MSM或者DDR3，相对于corePac内部的L1，L2内存而言），如CPU访问DDR3中的无权限内存时（即在当前CPU的配置中，没有设置对该内存的访问权限），硬件会触发MDMA bus error event(VbusM error event 110，CPU访问corePac内部资源L1，...
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2014-05-14 21:23:30
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本节讲述PDSP监控的配置。
QMSS PDSP：The queue manager sub system contains two or eight packed data structure processors (PDSP) and associated hardware that allow autonomous QMSS-related tasks with interrupt not...
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2014-05-11 04:02:36
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下面讲解在具体应用中，event与中断ISR的设置。以对QM的queue监控产生中断（不是EXCEP）为例，主要包括配置QM accumulator（用于监控QM queue）与配置ISR（ISR与event配置）。
首先介绍QM accumulator的配置，QM模块中QMSS（包含QMSS Tx queue 800:831，Tx/Rx channel 0:31，RxChan,TxChan,T...
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2014-05-10 04:52:49
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