安装雷达驱动过程中遇到的问题，走一步坑一步 ~/robosense$ catkin_makeBase path: /home/leo2/robosenseSource space: /home/leo2/robosense/srcBuild space: /home/leo2/robosense/b ...
Xilinx Vivado 提供了上板后的FPGA逻辑分析，信号视图显示等功能。 需要注意，上板后查看信号需要重新综合，并且需要耗费一定的片上布局布线资源。 1. 添加debug信号 可以对模块端口或者wire 变量进行debug信号提取，只要在verilog代码前面添加：(* MARK_DEBUG ...
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2019-12-06 21:17:01
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信号发生器要求： 信号发生器程序： library ieee;use ieee.std_logic_1164.all;entity signal_gen1 isport(clk:in bit;wave:out bit);end signal_gen1;architecture bhv of sign ...
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2019-12-01 18:54:43
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Problem Forecasting time series. Other methods' drawback: even though existing methods (exponential smoothing, auto-regression and moving average-MA, ...
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2019-11-28 18:54:23
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我们看看 TiDB 一段代码的实现 左外连接(Left Out Join)的消除; select 的优化一般是这样的过程: 在逻辑执行计划的优化阶段, 会有很多关系代数的规则, 需要将逻辑执行计划(LogicalPlan)树应用到各个规则中, 尝试进行优化改写; 我们看看其中的一条优化规则: out ...
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2019-11-24 17:36:47
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9.6偏序关系(Partial Order) 偏序(Partial Order) 定义: 偏序(Partial order)：定义在A上的集合R是偏序关系iff(当且仅当)其具有以下性质: 1. 自反性(reflexive) 2. 反对称性(antisymmetric) 3. 传递性(transti ...
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2019-11-15 18:33:18
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本篇内容来自《数据库系统概论（第五版）》（王珊 萨师煊），主要是整理数据库的基本概念，供自己复习查阅。 数据库常用逻辑数据模型 常用模型有： 网状模型 、 关系模型 、 面向对象数据模型 、 对象关系数据模型 、 半结构化数据模型 。其中，层次模型和网状模型又统称为 格式化模型 ，最重要的是 关系模 ...
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2019-11-14 10:06:08
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触发器： (1)D锁存器 library ieee; use ieee.std_logic_1164.all; entity dff1 is port(clk:in std_logic; d:in std_logic; q:out std_logic ); end; architecture bhv ...
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2019-11-09 19:35:53
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1.时钟信号和复位信号 （1）时钟信号的描述 若进程的敏感信号是时钟信号，这时时钟信号出现在process后的括号中。 例： process(clock_signal) begin if(clock_edge_condition) then signal_out<=signal_in 其他语句 en ...
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2019-11-09 17:53:27
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博文大纲什么是RAIDSoftware，hardwareRAID软件磁盘阵列的设置仿真RAID错误的救援模式开机自动启动RAID并自动挂载1.什么是RAID：1.磁盘阵列全名是“RedundantArraysofInexpensiveDisks,RAID”，英翻中的意思是：容错式廉价磁盘阵列。2.RAID可以通过一个技术（软件或硬件），将多个较小的磁盘整合成为一个较大的磁盘设备；而这个较大的磁盘功
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2019-11-07 23:16:32
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