文章来源 http://blog.chinaaet.com/detail/34609熟悉了xps的操作，IP添加，总线连接设置，图形化方法检查（open graphical design view），检查总线及端口连接。在file下面的图标中，打开导出到SDK并启动，完成程序编写。参考超群天晴的博客...
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2015-05-22 01:55:19
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文章来源http://www.cnblogs.com/surpassal/archive/2012/10/09/Zynq_Lab4.html本小节通过使用XPS中的定制IP向导(ipwiz)，为已经存在的ARM PS 系统添加用户自定IP(Custom IP )，了解AXI Lite IP基本结构，...
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2015-05-17 02:02:54
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文章转载自http://www.eefocus.com/Kevin/blog/11-08/228643_42a39.htmlkevin是xilinx的大牛，必须膜拜啊。还引自http://blog.sina.com.cn/s/blog_6cb263210101g8lv.html摘要:本文介绍与XIL...
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2015-05-16 23:12:48
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Zynq开发板FPGA比特流文件可以通过三种途径下载：
1. 利用SDK生成的FSBL.elf文件自动加载FPGA比特流配置文件，将比特流文件，FSBL.elf文件和u-boot.elf文件利用SDK工具生成BOOT.BIN文件。
2. 利用u-boot下面的命令方式下载：1>fpga info 0查看FPGA信息：
2>fatload mmc 0 0x1000000 design_...
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2015-05-08 18:16:22
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以zc702开发板的u-boot为例
链接地址（运行地址）：链接地址是在程序编译链接阶段就确定好的地址。
u-boot的链接脚本由CONFIG_SYS_LDSCRIPT宏定义来指定，如在zynq_common.h当中有如下代码：
#define CONFIG_SYS_LDSCRIPT "arch/arm/cpu/armv7/zynq/u-boot.lds"在该链接脚本中指定了u-b...
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2015-04-21 22:47:05
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http://blog.chinaaet.com/detail/36014Vivado是Xilinx最新的FPGA设计工具，支持7系列以后的FPGA及Zynq 7000的开发。与之前的ISE设计套件相比，Vivado可以说是全新设计的。无论从界面、设置、算法，还是从对使用者思路的要求，都是全新的。看...
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2015-04-06 17:09:31
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在编译ZedBoard的u-boot.elf（ssbl）中知道了编译u-boot的步骤，以及u-boot下载地址，这里使用2014.4版本。由于现在使用的是zc702开发板，所以应该使用如下命令编译u-boot：
1、make zynq_zc70x_config
2、make
其中第1条命令和第2条命令都会执行根目录下的Makefile文件，但是在Makefile文件中会判断make...
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2015-03-12 11:42:57
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（1）企业简介作为DSP 和视频应用领域的头号 FPGA 供应商，赛灵思致力于通过其目标设计平台提供业内领先的 DSP 开发工具、方法、IP 和技术支持。赛灵思面向 DSP 的目标设计平台将这些元素带入了产品化解决方案，为有经验的用户加快了开发速度，并且为新用户简化了FPGA 应用。工程师可以在应用...
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2015-01-26 18:50:10
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本文讲述怎样使用PS的gpio,不涉及fpga部分,软件涉及到一级引导程序fsbl的创建及app的创建,程序运行在ddr中.
z-turn板的mio 50引脚连接到了按键K1,该实验实现的功能为,检测按键并从串口打印出相应的信息.
1. 用vivado搭建硬件模型.
在block design的Re-customize IP界面,点击Pre...
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2015-01-22 13:16:41
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由于所有的APP都是在DDR中运行的,所以先让DDR工作起来是后续实验的基础.使用的硬件是z-turn开发板.
本文主要讲怎样创建一个内存测试程序,测试DDR,程序还是运行在内部RAM;FPGA涉及的内容有怎样配置DDR参数,及怎样保存和导入硬件参数;软件方面会涉及BSP修改及 BOOT.bin的生成.关于Vivado的具体操作请参考--"Zynq
700...
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2015-01-22 11:07:19
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