从事嵌入式linux工作也几年了，如果算上大学期间的自学，那么也算是个工程师了。期间写过底层bootloader、内核的驱动和上层应用程序。对于芯片内部的模块也在大学时候用fpga的verilog玩过，所以对于整个嵌入式的框架也算是有点小小的理解，今天我们一起来来谈谈。如有偏差，请各位不吝赐教! 首 ...
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2019-07-31 16:57:19
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1.硬核处理器与软核处理器在芯片内的硅片上通过划分一定的区域来实现处理器功能称为硬核处理器。在一些对处理器性能要求不高的场合，通过使用FPGA内部资源搭建一个处理器功能称为软核处理器。如果采用硬核处理器，整个芯片的成本会较高，且灵活性相对较差，但性能较高。如果采用软核处理器，成本较低，同时灵活性较高，但性能较低。2.Zynq-7000SOC功能结构Zynq-7000由PS(ProcessingSy
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2019-07-30 13:00:26
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（1） Grey码在FPGA实际应用中是实用的码，在8421BCD码累加计数器中，如果寄存器需要发生多位（两位或者以上）的跳变，会出现中间态，这样作为组合逻辑的输入是不稳妥的。 下面看两个中间态的例子： 这是累加器的状态转换时序观察，存在中间不希望的状态。如果作为组合逻辑的输入，状态有可能跑飞。 左 ...
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2019-07-28 17:51:53
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1、关于怎么使用fifo和bram。 (1) 我需要一个人给我确切的说法，为什么需要人告诉？怎么从文档里总结？时序图。 (2) 别人都提供了哪些信息。 ① 1、有几根信号线，各个信号线都有什么作用。 ② 各个信号线的对应时序。需要测试验证。 2、对于时序的测试验证方式： （1）数据验证 对应使能信号 ...
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2019-07-25 23:50:34
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HPS 如何对FPGA外设进行操作？hardware：在Qsys中将外设连接到AXI bridge上software：映射外设物理地址到到应用程序可以操作的虚拟地址，应用程序通过得到的虚拟地址入口控制外设。 也就是说hps访问FPGA中的外设时，可以使用MPU来进行虚拟地址的分配 MPU将以有的外设 ...
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2019-07-20 17:16:06
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1.1基本信息产品名称:啄木鸟扫描模块产品型号：Piculus-200V1.01.2基本功能简述图1–1采集板HTSNR_BF7_V6.0主板外观Piculus-200V1.0模块产品主板如图1-1所示，基于FPGA+DSP+DDR+USB2.0硬件架构，配合200mm幅面CIS传感器模组，实现200mm幅面高速双面图像采集。?USB2.0接口上位机通信批处理模式数据传输和命令交互；平均数据传输速
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2019-07-12 00:37:46
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域间数据传递之域外为慢速数据 域外慢速数据可以用事件来同步，具体参展王贞炎老师的《FPGA应用开发和仿真》4.5.4节。 这里给出一种Verilog实现方式。 sync_data.v `timescale 1ns/100ps module sync_data ( parameter NUM_OF_B ...
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2019-07-05 16:39:50
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今天我们来说一说如何通过 Azure Batch 实现多快好省的 AI 训练。多：Azure 云平台提供各种规格型号的计算服务资源，从 CPU 到 GPU 再到 FPGA，响指一打最新的 V100 卡加持 NVLINK 手到擒来。快：Azure 平台除了基础的计算资源外，还提供其它丰富的产品和工具， ...
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2019-07-01 00:46:21
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前言 为了避免每次SPI驱动重写，直接参数化，尽量一劳永逸。 SPI master有啥用呢，你发现各种外围芯片的配置一般都是通过SPI配置的，只不过有3线和四线。 SPI slave有啥用呢，当外部主机（cpu）要读取FPGA内部寄存器值，那就很有用了，fpga寄存器就相当于RAM，cpu通过SPI ...
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2019-06-29 14:48:12
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本原理：在 windows 环境下借助 ADS 仿真器将在 SDRAM 中的一段存储区域中的数据写到 Nand flash 存 储空间中。烧写程序在纵向上分三层完成： 第一层: 主烧写函数（完成将在 SDRAM 中的一段存储区域中的数据写到 Nand flash 存储空间中）； 第二层: 为第一层主 ...
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2019-06-29 10:50:57
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