以下内容摘自《步步惊芯——软核处理器内部设计分析》一书
12.1 Cache基本知识
12.1.1 Cache的作用
处理器的设计者一般会声称其设计的处理器一秒钟能做多少次乘法、每条指令只占用xx个时钟周期，可是当我们实际使用处理器时，就会发现并不是那么回事，比如在第11章，从图11.8中可以发现，当程序运行在简单SOPC上时，原先设计在执行阶段只需要一个时钟周期的指令l....
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2014-06-19 11:51:49
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ARM存储系统：
ARM中用于存储管理的系统控制协处理器CP15：
包含16个32位寄存器，其编号为0到15。实际上对于某些编号的寄存器可能对应有多个物理寄存器。
访问CP15寄存器的指令：MRC、MCR。
CP15中的寄存器C0和C1：C0中存放ARM相关的一些标示符；C1是一个控制寄存器，用于禁止/使能MMU、配置存储系统等。
例如下面的代码序列使能MMU：
MRC P15，0，R...
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2014-06-15 19:12:47
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流水线时空图。流水线要经过装入、充满、排空三个阶段。...
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2014-06-15 15:59:59
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ARM异常中断处理：
ARM体系异常中断种类：按中断的处理优先级从高到低依次为：复位、数据访问中止、快速中断请求、外部中断请求、预取指中止、未定义指令、软件中断。
ARM体系中的异常中断向量表：
0x0 复位
0x4 未定义指令
0x8 软件中断(SWI)
0x0c 预取指中止
0x10 数据访问中止
0x14 保留
0x18 外部中断请求(IRQ)
0x1c 快速中断请求(F...
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2014-06-15 15:07:19
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在多指令流多数据流MIMD里面有用到基于超立方体互联的网络，
用《图论导引》里面简单的描述，就是处理器能通信，当且仅当他们的邻接（k元祖代表了处理器的地址）
一个 k 维立方体（或者超立方体Qk）是一种简单图，每个顶点{0,1}标记的k元祖来表示。
相邻的顶点之间的 k 元祖只有一个位置上数字不同，Qk 的生成立方体 Qj 和 Qj 本身同构。
这是Q3的表示：...
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2014-06-15 14:42:41
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题目：学生管理系统
1. 语言和环境
A、实现语言：
C
B、实现技术：
C语言
C、环境要求：
VC++6.0
2. 要求
实现一个学生管理系统。
功能和界面设计要求：
1、 运行后显示主界面
2、 根据操作指令进行相应的操作，具体要求如下:。
3. 推荐实现步骤
. 设计程序
制作主界面：
A、设计登录窗体，界面如下图1所示。（10分）
...
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2014-06-14 17:27:39
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当某线程触发GC时,任何线程不能再访问任何的对象.在GC执行时,可能会修改对象的地址.GC执行时,大多使用劫持法,将所有的线程挂起.对于含有Loop,且Loop内不再调用其它方法时.会生成一个编译时表.当线程的指针指令执行到该处时,会认为到达了一个安全点,线程可以被挂起.对于其它方法,GC会劫持线程...
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2014-06-14 15:57:14
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阵列处理机：
通过重复设置大量相同的处理单元PE（Processing Element），将它们按一定方式互连成阵列，在单一控制部件CU（Control Unit）控制下，对各自所分配的不同数据并行执行同一组指令规定的操作。是操作级并行的SIMD计算机（SIMD指的是单指令流多数据流，是一种实现数据级并行的技术）。
阵列处理机的构形：
分布式存储器的阵列处理机构形集中式共...
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2014-06-14 15:05:57
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CISC的特点：
指令系统庞大，指令功能复杂，指令寻址方式多，指令格式多绝大多数指令需要多个机器周期完成各种指令都可以访问存储器采用微程序控制有专用寄存器，少量难以用优化编译技术生成高效的目标代码程序
RISC特点：
大多数指令在单周期内完成LOAD/STORE结构硬布线控制逻辑减少指令和寻址方式的种类固定的指令格式注重编译的优化（三地址指令格式、较多的寄存器、对...
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2014-06-14 12:22:43
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OR1200中实现ICache的文件有or1200_ic_top.v、or1200_ic_fsm.v、or1200_ic_tag.v、or1200_ic_ram.v、or1200_spram.v，分别实现了ICache模块、IC_FSM模块、IC_TAG模块、IC_RAM模块、单口RAM。在ICache中例化了IC_FSM、IC_TAG、IC_RAM模块，在IC_TAG、IC_RAM模块中例化了单口RAM。如图12.4所示。其中IC_TAG、IC_RAM可以称为数据部分，IC_FSM可以称为控制部分，在数据...
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2014-06-14 06:24:13
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