前面高速先生已经讲解过众多的DDR3理论和仿真知识，下面就开始谈谈我们LATOUT攻城狮对DDR3设计那些事情了，那么布局自然是首当其冲了。 ...
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2017-05-12 18:58:27
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【干货】电路设计师指导手册（已更新完毕） 第一部分：接地与布线第二部分：电源返回路径与I/O信号接地第三部分：板间互连、星形接地及屏蔽第四部分：安全地以及电线/电缆第五部分：射频电缆、双绞线与串扰 ...
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2017-05-05 10:44:29
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这章的主要内容是：如何共享和发布对象，从而使它们能够安全地由多个线程同时访问。 内存的可见性 不仅希望防止某个线程正在使用对象状态而另一个线程在同时修改该状态，而且希望确保当一个线程修改了对象状态后，其他线程能够看到发生的状态变化。 上面的程序中NoVisibility可能会持续循环下去，因为读线程 ...
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2017-04-29 14:20:55
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安全技术 特别是当要把相离较远的节点联接起来时，架设专用通信线路的布线施工难度大、费用高、耗时长，对正在迅速扩大的连网需求形成了严重的瓶颈阻塞。WLAN就是解决有线网络以上问题而出现的，WLAN为Wireless LAN的简称，即无线局域网。无线局域网是利用无线技术实现快速接入以太网的技术。与有线网 ...
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2017-04-29 13:45:52
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WLAN优点 安装便捷 安装便捷 在网络建设当中，施工周期最长、对周边环境影响最大的就是网络布线的施工了。在施工过程时，往往需要破墙掘地、穿线架管。而WLAN最大的优势就是免去或减少了这部分繁杂的网络布线的工作量，一般只要在安放一个或多个接入点（Access Point）设备就可建立覆盖整个建筑或地 ...
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2017-04-29 13:40:23
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使用Synplify Pro加时序约束。综合完毕后，可以在ISE中进行布局、布线。需要用.ucf文件指定布局布线的时钟约束。前者可以比后者小。 早期的ISE，两个约束可以继承。现在用的高版本，反而需要分别指定，否则会忽略掉。 将综合（Synthesis）的频率提高，将布局布线（Place & rou ...
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2017-04-23 11:21:32
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布线问题 时间限制：1000 ms | 内存限制：65535 KB 难度：4 布线问题 时间限制：1000 ms | 内存限制：65535 KB 难度：4 #include<bits/stdc++.h>using namespace std;#define N 205005int u[N],v[N] ...
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2017-04-17 18:06:14
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1231 最优布线问题 1231 最优布线问题 时间限制: 1 s 空间限制: 128000 KB 题目等级 : 白银 Silver 时间限制: 1 s 空间限制: 128000 KB 题目等级 : 白银 Silver 时间限制: 1 s 时间限制: 1 s 空间限制: 128000 KB 空间限制 ...
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2017-04-17 15:55:13
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转载自： http://www.chipsbank.com/news_detail/newsId=121.html 1.后仿是否必要随着芯片规模的增大，关于IC设计流程中的后仿是否必要，有多种声音。 认为不必要的理由是：布局布线后的网表，已经可以通过STA保证时序，后仿只不过是确认一遍电路的时序。而 ...
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2017-04-16 23:45:45
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1231 最优布线问题 1231 最优布线问题 时间限制: 1 s 空间限制: 128000 KB 题目等级 : 白银 Silver 时间限制: 1 s 空间限制: 128000 KB 题目等级 : 白银 Silver 时间限制: 1 s 时间限制: 1 s 空间限制: 128000 KB 空间限制 ...
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2017-04-16 22:46:40
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