#include <string> #include <map> #include <iostream> int main(void) { std::map<int,std::string> test_map; test_map[1] = "value1"; test_map[2] = "value ...
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2020-07-18 15:45:39
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China and Buddhism By far the most important gift that China received from India was neither cotton, nor sugar, nor the knowledge of saltpeter, but a ...
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2020-07-18 15:35:38
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~/.vimrc内容如下： set nocompatible filetype off set rtp+=~/.vim/bundle/Vundle.vim call vundle#begin() Plugin 'VundleVim/Vundle.vim' Plugin 'tpope/vim-fugi ...
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2020-07-18 13:52:57
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XProtect installer may fail with the error "Category does not exist" or "Cannot load Counter Name data because an invalid index" When running the XPro ...
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2020-07-17 19:49:17
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之前一直以为while 语句只能在函数中执行,今天算是涨知识了. DO $$ DECLARE i INTEGER := 1; identityId BIGINT := 200000000001; BEGIN WHILE i < 100 LOOP identityId = identityId + 1 ...
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2020-07-17 19:32:52
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verilog之时钟信号的编写2 1、时钟信号的特点 时钟信号除了可以根据时序一个个变化列举出来，还可以利用其循环的变化的特点，使用循环执行语句always来实现。这种方法实现的时钟信号可以一直执行且不需要关注每个变化点的延时。 2、基于begin-end块的时钟信号 initial begin c ...
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2020-07-17 09:38:10
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.gitignore常用配置 #Maven beginning target/ pom.xml.tag pom.xml.releaseBackup pom.xml.versionsBackup pom.xml.next release.properties dependency-reduced-po ...
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2020-07-17 09:28:37
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--语句新建一个定时任务 declare job number;BEGIN DBMS_JOB.SUBMIT( JOB => job, /*自动生成JOB_ID*/ WHAT => 'p_monitor_tablespace;', /*需要执行的存储过程名称或SQL语句*/ NEXT_DATE => ...
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2020-07-16 21:24:07
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verilog之简单时钟信号的编写 1、数字时钟信号 在数字电路中，时钟信号是重要的一类信号，一般作为激励源驱动时序电路。掌握时钟信号的编写，对于时序电路的仿真具有重要意义。所有的时序电路都需要设置时钟信号来确认时序。这里先写一个已知时间间隔的简易时钟信号。 2、基于begin-end的编写 ini ...
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2020-07-15 23:38:36
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#include <iostream> #include<algorithm> #include<vector> using namespace std; void swap(int& a, int& b) { int t = a; a = b; b = t; } void quicksort(ve ...
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2020-07-15 23:16:35
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