title: Jz2440开发板熟悉 tags: ARM date: 2018 10 14 15:05:56 概述 外部晶振为12M Nand Flash 256M，Nor Flash 2M，SDRAM 32 2=64M | 分区 | 内容 | Nand flash地址分配 | | | | | | ...
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2018-11-27 01:38:26
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title: Cache tags: ARM date: 2018 11 04 12:52:02 Cache与写缓冲 引入 Cache实际上也是一块存储空间，最大的优点就是速度快.CPU和SDRAM通信速度慢，取指令，读写数据都需要等待，所以中间出现了一个Cache用来解决这个问题.计算机一般有多级 ...
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2018-11-27 01:33:20
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title: u boot(三)启动文件 tags: linux date: 2018 09 24 20:56:05 u boot(三)启动文件 [TOC] 汇编 u boot也是一个牛逼的单片机程序，所以也就需要: 1. 硬件相关初始化 1. 看门狗 2. 时钟 3. sdram 4. nand ...
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2018-11-27 01:18:35
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推荐大家预先建立好一个工程目录文件夹，确实挺好用，参考正点原子的pdf教程，如下图所示， 我们eclipse在software文件夹建立一个workspace即可 选择用helloworld模板建立工程，因为这样可以避免一些问题，比如我遇到的，system.h等头文件引用失败等等问题 然后选中bsp ...
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2018-11-26 13:46:03
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LCD12864引脚如下： FPGA开发板得提供，3.3v电压，5v电压，普通io都是3.3v电压 DB：数据脚，得用双向io,因为程序里面需要读取液晶的应答（普通io3.3v可以） E:?输出引脚即可，普通io3.3v可以 RW:?输出引脚即可，普通io3.3v可以 RS:?输出引脚即可，普通io ...
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2018-11-26 13:42:41
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外部时钟 时钟信号的来源在FPGA芯片外部，通常的，外部时钟对于FPGA来说是必需的，因为FPGA内部没有供内部逻辑使用的时钟和激励电路。 2内部时钟 再生时钟 再生时钟是以一个输入时钟作为参考，在此基础上通过调整其频率和相位产生的新时钟，FPGA中产生再生时钟信号的模块只有PLL和DCM（注意，两 ...
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2018-11-20 21:44:01
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更新：2018年11月18日 第一次建立。以后补上。。。 随着fpga的速度越来越快，稍微高端一点的fpga都有serdes接口，到底这个接口是干什么的？如下： ...
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2018-11-18 22:38:20
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用加法器实现T型曲线的理论分析 // 2017年12月28日 建立 by cofin T型加速曲线公式：如下所示： Vt = v0+at （1） S = 1/2at2 + v0*t （2） 举例，如果我们要在5MHz下产生一个1Khz的方波，那么我们需要用5M/1K = 5000 来得到计数数值，然 ...
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编程语言 时间：
2018-11-18 22:30:31
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最近想要实现CNN的FPGA加速处理，首先明确在CNN计算的过程中，因为卷积运算是最耗时间的，因此只要将卷积运算在FPGA上并行实现，即可完成部分运算的加速 那么对于卷积的FPGA实现首先要考虑的是卷积子模板具体如何实现，我们在matlab或者c实现比如3X3的子模板的时候，只要用一个数组即可将模板 ...
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2018-11-16 23:32:01
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1、没用到的CLK接地。 2、MSEL内部接9k电阻，但依然要接地或者VCCA。 3、nConfig是输入，拉高10kΩ到VCCIO；拉低会复位，然后拉高才会重新配置。 4、nCE是FPGA的片选，接地。多芯片时nCEO级联下一个FPGA的nCE。必要性是什么还不知道。 5、CONF_DONE开漏， ...
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2018-11-12 14:53:23
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