0.1uf和10uf的作用？都是退耦 0.1uf是高频段 10uf是低频段 两者并联可以保证在很宽的频率范围内保持一个较低的交流阻抗 而且并联后电容的ESR也会降低10微法电容滤的是低频本质上说，就是稳压。。其实这个10微法电容类似一个水管流出的地方加的蓄水池，通过蓄水池后的水更加平稳而已，，，，
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2014-08-20 08:08:46
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本次测试采用的芯片是STM32F103CB我的开发板如下：此开发板有8个led，分别为D11,D12，D13，D14，D15，D16，D17，D18。查询核心板的电路图后知道其对应芯片的控制引脚为P0.0,P0.1,P0.2,P0.3,P0.4,P0.5,P0.6,P0.7,P0.8。现在开始测试点...
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2014-08-19 02:07:53
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CH340芯片外围电路非常简单，所以很喜欢用。
之前用过CH340T，TSSOP封装。这次改用CH340G，SOP16封装。和CH340T基本相同。
本应该很顺利的调试，但是却因为驱动程序耽误了好长时间。
现象：
连接电脑后，能够发现设备。（CH340，COM），但是打了个叹号。提示“由于 Windows 无法加载这个设备所需的驱动程序，导致这个设备工作异常。 (代码 31）”
...
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2014-08-18 20:30:12
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##TTL TTL集成电路的主要型式为晶体管－晶体管逻辑门 （transistor-transistor logic gate），TTL大部分都采用5V 电源。 - 输出高电平Uoh和输出低电平Uol Uoh≥2.4V,Uol≤0.4V - 输入高电平和输入低电平 Uih≥2.0...
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2014-08-18 12:42:55
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水平序 Graham 扫描算法：计算二维凸包的时候可以用到，Graham 扫描算法有水平序和极角序两种。极角序算法能一次确定整个凸包，但是计算极角需要用到三角函数，速度较慢，精度较差，特殊情况较多。水平序算法需要扫描两次，但排序简单，讨论简单，不易出错。【算法流程】
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2014-08-18 10:42:53
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CDC（不同时钟之间传数据）问题是ASIC/FPGA设计中最头疼的问题。CDC本身又分为同步时钟域和异步时钟域。这里要注意，同步时钟域是指时钟频率和相位具有一定关系的时钟域，并非一定只有频率和相位相同的时钟才是同步时钟域。异步时钟域的两个时钟则没有任何关系。这里假设数据由clk1传向clk2。
单bit传输时，同步时钟域因为频率和相位关系都是已知的，可以推导的，所以不需要采用额外的硬件电路...
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2014-08-17 20:00:33
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Pspice现在是集成到Cadence中的一个电路仿真工具，能通过Pspice模型的原理图仿真电路的输出结果。其大致步骤是：1. 创建仿真工程执行菜单命令File->New->Project，选择Analog or Mixed A/D，然后选择一个模板（这个看自己需要，也可以是空工程）2. 添加仿真元件库仿真所用的元件必须要有Pspice模型，Cadence安装目录下\tools\capture\...
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2014-08-13 22:24:07
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题目链接：http://acm.hdu.edu.cn/showproblem.php?pid=4941解题报告：给你一个n*m的矩阵，矩阵的一些方格中有水果，每个水果有一个能量值，现在有三种操作，第一种是行交换操作，就是把矩阵的两行进行交换，另一种是列交换操作，注意两种操作都要求行或列至少要有一个水...
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2014-08-13 14:48:56
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如果大家有印象的话，尤其是夏天，如果家里用电负载过大，比如开了很多家用电器，就会”自动跳闸”，此时电路就会断开。在以前更古老的一种方式是”保险丝”，当负载过大，或者电路发生故障或异常时，电流会不断升高，为防止升高的电流有可能损坏电路中的某些重要器件或贵重器件，烧毁电路甚至造成火灾。保险丝会在电流异常...
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2014-08-13 00:29:14
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刚拿到的新板子，把程序烧录进去，但是运行地址不对，没进入到c语言
检查以下四种情况
1.检查芯片电源是否全对
2.检查晶振线是否短路
3.检查负载电容是否正确
4.检查你的复位电路元件是否正确
用示波器查看晶振没有反映
出现的问题是复位电路不正确，切记boot0=0 keil调试模式必须这样设置
再次用示波器检查，晶振震动了，程序也跳入到了c语言。...
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2014-08-12 19:04:44
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