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搜索关键字:reg    ( 6610个结果
8148之更换摄像头出现异常---REISZER OVERFLOW OCCURED: RESTARTING
my iss config as:rsz_reg->SRC_VSZ = 1079;//715; rsz_reg->SRC_HSZ = 1919;//1277; rszA_reg->RZA_V_DIF = 256; rszA_reg->RZA_H_DIF = 256; rszA_reg->RZA_DW...
分类:其他好文   时间:2014-12-02 20:46:10    阅读次数:237
电脑右键无法以管理员身份运行桌面的应用程序快捷图标问题
处理办法如下:一:新建和个.txt的文件,并重新命名为change.reg二:右键-》编辑三:在打开的窗口中输入如下代码,并保存。Windows Registry Editor Version 5.00 [HKEY_CLASSES_ROOT\CLSID\{20D04FE0-3AEA-1069-A2D...
分类:其他好文   时间:2014-12-01 12:49:16    阅读次数:208
其他常用的正则表达式
/^([0-9]{1,}\.[0-9]{1,}|[0-9]{1,})$/ 数字或小数点^[0-9]{1,}\.[0-9]{1,}$ 或 /^\d+\.{0,1}\d+$/ 数字和小数点//验证手机号码function checkStr(str){var reg= /^[1][3458]\d{9}$/...
分类:其他好文   时间:2014-12-01 11:20:48    阅读次数:182
verilog 阻塞赋值和非阻塞赋值
1 module main(); 2 reg clk=0; 3 reg [11:0] a=0; 4 reg [11:0] b=0; 5 always #50 clk=~clk; 6 always@(clk) 7 begin 8 a=a+4; 9 b<=a/4;10 end11 endm...
分类:其他好文   时间:2014-11-30 00:17:59    阅读次数:191
cpu设计-->verilog理解
Verilog HDL语言中的变量只有网线wire和寄存器reg两大类数据类型。网线类型表示Verilog HDL结构化元件间的物理连线,它的值由驱动它的源器件的值决定,如果没有驱动源器件连接到网线,网线的缺省值为高阻z。寄存器类型表示一个抽象的数据寄存器,它只能在always语句和initial语...
分类:其他好文   时间:2014-11-29 21:27:33    阅读次数:302
verilog同一个reg变量同时发生多个阻塞赋值的情况分析
1 module main(); 2 reg [5:0] a=0; 3 reg [5:0] b=0; 4 reg clk=0; 5 6 always@(clk) 7 begin 8 a<=a+3; 9 b<=b+1;10 end11 12 always@(b)13 begin14 ...
分类:其他好文   时间:2014-11-29 18:53:38    阅读次数:497
批处理文件的相对路径问题
在注册控件的时候,我一般会在OCX或DLL目录下放一个reg.bat,注册控件的时候就会比较方便些,但遇到WIN7之类对权限有要求的系统,有点让人无奈,总是提示找不到控件依赖的其他二进制文件,例如IECS2.DLL依赖IMAP.DLL,在注册IECS2.DLL时,会出现如下图所示的问题 很显然的问题是路径不对,可是路径究竟是怎么一回事呢? 一般来说,批处理文件处理相对路径的时候...
分类:其他好文   时间:2014-11-29 14:35:51    阅读次数:195
触摸屏
函数及思路讲解:1.对于LCD_Init();void LCD_Init(void){ LCD_GPIO_Config(); LCD_FSMC_Config(); LCD_Rst(); LCD_REG_Config();}主要对FSMC总线配置定义,及对LCD初始化寄...
分类:其他好文   时间:2014-11-27 20:10:31    阅读次数:165
Shadow Register 是什么?
ARM处理器有个Shadow Register的概念,查了很多资料,语焉不详,究竟是什么意思呢?这其实是个和硬件有关的概念。有些register是2层的,第一层是供CPU访问,第二层供Hw访问。CPU访问Hw访问其中Hw访问的这层register称之为Shadow Register。CPU在写Reg...
分类:其他好文   时间:2014-11-25 17:47:11    阅读次数:356
Verilog学习笔记
1.用Forever循环和disable实现5到67的计数器。 1 `timescale 1ps/1ps 2 module tst5_25(); 3 reg clk; 4 reg [7:0]count; 5 6 initial fork:CNT 7 clk = 0; 8 count = 5...
分类:其他好文   时间:2014-11-25 16:04:13    阅读次数:196
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