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2016-11-11 11:48:13
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1、在服务器端建立新空间，方便封装库以及数据库的归档存放 服务器路径：\\192.168.1.234\Share\STG_LIB，文件夹内容如下，其中Datesheet存放物料数据手册，Pcb_Lib存放Allegro封装，Schematic_Lib存放Capture封装，STG_Datebase存 ...
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2016-11-10 19:18:40
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前言：si的教程市面上是很少的，layout是台湾工程师的强项，还有就是日本人，国人爱用AD。 si的教程中靠谱的还是张飞的收费课程，还有华为的资料。 Cadence SI 仿真实验步骤如下： 1.熟悉Allegro PCB SI中的设置向导 a) 利用Allegro PCB SI中的设置向导设置印 ...
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2016-11-10 01:39:53
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1、单位：1mil = 0.0254mm 2、default线宽及线距（综合考虑高速电路性能及PCB板厂制程能力）：6mil 3、差分走线特征阻抗：100ohm 4、3W原则，即线间距采用3倍线宽，多用于时钟线，差分线等系统关键高速走线 5、高速电路：数字电路频率在50MHz以上即称为高速电路 6、 ...
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2016-11-03 02:37:47
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少啰嗦，原理图。。 谁能想到PCB长啥样呢？ 明天先歇一歇，打打代码。电子有毒！！！ System.out.pringln(“Good night world！！”); ...
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2016-11-02 07:56:30
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我们都知道通过fork()系统调用我们可以创建一个和当前进程印象一样的新进程.我们通常将新进程称为子进程,而当前进程称为父进程.而子进程继承了父进程的整个地址空间,其中包括了进程上下文,堆栈地址,内存信息进程控制块(PCB)等. 1.父子进程 那么我们首先来先说说父进程和子进程之间的区别: 父进程设 ...
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2016-11-02 07:46:02
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带状线：走在内层(stripline/double stripline),埋在PCB内部的带状走线，如下图所示 蓝色部分是导体，绿色部分是PCB的绝缘电介质，stripline是嵌在两层导体之间的带状导线。 因为stripline是嵌在两层导体之间，所以它的电场分布都在两个包它的导体（平面）之间，不 ...
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2016-11-01 14:29:15
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从系统调用返回到用户空间是否调度,从ret_with_reschedule可看出,是否真正调度,取决于当前进程的pcb中的need_resched是否设置为1,那如何设置为1取决于以下几种情况:时间中断处理程序,发现当前进程运行时间过长:每次发生时间中断,都要递减该进程的时间片,一旦count为0,... ...
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2016-10-27 12:11:54
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PCB的设计规则可以分布局与走线。布局里最简单的原则就是避免信号之间的干扰，有把模拟部分与数字部分分开，把开关电源与数字部分分开，把端去耦电容靠近端点，而且从端点出来的电容容值按从小到大摆放效果会好些，再其次，在去耦电容外面就是该端接电阻了，它也要尽量靠近端点。走线里首先是要把电源线设置的粗一些，其 ...
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2016-10-22 17:15:36
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