verilog设计： 分频器的设计： 分频器就是将一个时钟源的频率降低的过程（可以通过观察分频之后周期中包含几个原时钟周期来看是几分频），分频分为基数分频也分为偶数分频， 偶数分频的代码如下：（其中就是计数器翻转的过程） 奇数分频（计数不用以整个周期为单位） ...
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2018-07-14 16:34:07
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计算机组成原理 第一章 系统概述 计算机系统: 硬件:组成计算机的各种实体。 软件:泛指各种程序和文件。 （运算器、控制器）=>中央处理单元CPU 存储器、输入设备、输出设备 这五大设备通过总线和接口连接起来，成为一台计算机。 1.运算器 一次能算多少位 若32位，则寄存器可存的位数是32位。 若3 ...
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2018-07-07 22:21:49
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关于tpg例程的仿真 processor system reset rst_clk_wiz_0_148M 可以看出interconnect_aresetn和peripheral_aresetn的复位作用时间不同，内部复位的时间会短好几个时钟周期。peripheral_aresetn和peripher ...
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2018-06-28 15:18:44
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时钟周期 时钟周期也称为振荡周期，定义为时钟脉冲的倒数（时钟周期就是单片机外接晶振的倒数，例如12M的晶振，它的时钟周期就是1/12us），是计算机中的最基本的、最小的时间单位。 在一个时钟周期内，CPU仅完成一个最基本的动作。时钟脉冲是计算机的基本工作脉冲，控制着计算机的工作节奏。时钟频率越高，工 ...
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2018-06-23 14:37:06
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这个是没有对比关系的。需要看处理器的微指令。计算机的GHz指的是CPU的时钟频率，不同的指令需要的时钟个数是不同的，列如，从内存读一个数据，一般需要4个时钟周期，而进行一次8位数的加法运算，一般需要16个时钟周期，而将数据写入内存，则需要6个时钟周期。那么进行一次完整的加法运算需要读2个数据，8个周 ...
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2018-06-06 10:49:13
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软考解析：2015年上半年上午试卷 5.【计算机组成】 总线频率=200MHZ/5=400MHZ，因为每5个时钟周期传送一个字，即总线频率为时钟频率的五分之一。 总线带宽 = 总线宽度(bit)/8(bit/B) * 总线频率(MHZ)=32/8 * 40MHZ = 160MB 6.【流水线技术】 ...
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2018-05-24 23:00:20
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第四步：网络验证的逻辑开发 1.将model注册到adminx.py中 1.在apps/yanzheng目录下新建admin.py 文件，添加代码： 2.修改apps/yanzheng/apps.py为： 这时，再重启项目，登录到http://127.0.0.1:8000/xadmin/ 发现数据表 ...
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2018-05-03 20:04:30
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重点掌握：MAR和MDR的含义，主存容量大小、CPU执行时间的计算，性能指标CPI、MIPS、主频等等。 1. 存储单元：CPU访问存储器的基本单位，每个单元有一个地址。通常是字节大小的整数倍。 2. CPU时钟周期 = 1/主频，单位通常是MHz 3. CPU执行时间 = CPU时钟周期数 * 时 ...
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2018-05-02 02:25:05
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今天分享的是89c51系列单片机的内部资源定时器/计数器，在所有的嵌入式系统中都包含这两个内部功能。首先先了解几个定时器/计数器相关的概念：?时钟周期：时钟周期 T 是时序中最小的时间单位，具体计算的方法就是1/时钟源频率，（一般单片机采用的是11.0592mHz）?机器周期：我们的单片机完成一个操... ...
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2018-04-29 13:36:36
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DMA:如果将一串字符串通过串口传送到外设中去，用传统的方法，则CPU将不断的去扫描UTSTAT这个寄存器，在字符发送期间，CPU将不能做任何其他事情。为了解决这个问题，则在诞生了DMA CPU只需要告诉DMA控制器，目标地址和目的地址就行了，其他事情就直接交由DMA去完成。 DMA控制器控制：通道 ...
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2018-03-17 14:18:11
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