20135311傅冬菁 分析Linux内核创建一个新进程的过程 一、学习内容 进程控制块——PCB task_struct数据结构 PCB task_struct中包含： 进程状态、进程打开的文件、进程优先级信息 操作系统管理的三个功能： 1.进程管理 2.内存管理 3.文件系统 Linux进程的状 ...
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2016-03-31 12:32:35
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第五周 进程的描述和进程的创建 一、进程描述符task_struct数据结构 1.操作系统三大功能 进程管理 内存管理 文件系统 2.进程控制块PCB——task_struct 也叫进程描述符，为了管理进程，内核需要对每个进程进行描述，它就提供了内核所需了解的进程信息。 struct task_st ...
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2016-03-31 02:00:08
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一、原理分析 1.进程的描述 进程控制块PCB——task_struct，为了管理进程，内核必须对每个进程进行清晰的描述，进程描述符提供了内核所需了解的进程信息。 2.进程的创建 道生一（start_ kernel...cpu_ idle），一生二(kernel_ init和kthreadd)，二生 ...
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2016-03-30 23:58:30
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是为了管理进程设置的一个数据结构。是系统感知进程存在的唯一标志。通常包含如以下的信息：(1)进程标识符(唯一)(2)进程当前状态，通常同一状态的进程会被放到同一个队列；(3)进程的程序和数据地址(4)进程资源清单。列出所拥有的除CPU以外的资源记录。(5)进程优先级。反应进程的紧迫程度(6)CPU现 ...
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2016-03-28 02:02:49
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Allegro生成Gerber数据时，默认会保存在与pcb文件相同目录路径下，Gerber数据本身就会生成好几个文件，然后与pcb文件，log文件，临时文件等混杂在一起，不易整理打包Gerber数据，更好地做法是将Gerber数据生成到指定目录，提交给板厂时直接zip一压缩即可，不会遗漏也不会出错。 ...
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2016-03-27 01:29:21
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在高速系统中FPGA时序约束不止包括内部时钟约束，还应包括完整的IO时序约束和时序例外约束才能实现PCB板级的时序收敛。因此，FPGA时序约束中IO口时序约束也是一个重点。只有约束正确才能在高速情况下保证FPGA和外部器件通信正确。 由于IO口时序约束分析是针对于电路板整个系统进行时序分析，所以FP
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2016-03-22 17:28:35
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任务表 周任务 1.verilog预习周末的课程 2.准备智能小车元件 3.学画pcb 4.pwm/DAC 今日任务 智能小车元件 pwm/dac 完成程度 TIM(PWM),Verilog预习 日省 期许和猜想 1.保持学习节奏，有计划的学习生活 2.保持对人文知识的憧憬 3.当日三省！ 4.从容
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2016-03-12 09:09:51
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由于每家公司发展到一定规模后，都有自己固有的规范，每家PCB打样制版厂可能要求有点区别，所以要熟悉每一家的制版规范以及工艺要求。 我们在画好PCB之后，都需要做一些简要说明，免得打板回来没有按照自己的要求，免得出现分歧，浪费研发周期时间。 Mechanical1层(下面的说明必须写入PCB板中) K
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2016-03-11 10:18:33
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之前在设计板卡时，只是听过相关的概念，但是未真正去研究关于SI相关的知识。将之前看过的一些资料整理如下： （1）信号完整性分析 与SI有关的因素：反射，串扰，辐射。反射是由于传输路径上的阻抗不匹配导致；串扰是由于线间距导致；辐射则与高速器件本身以及PCB设计有关。 传输线判断 传输线的判断可以参考之
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2016-03-10 12:42:18
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之前设计板卡时，未曾系统的学习关于SI相关知识。将之前的资料整理如下： 与SI有关的因素：反射，串扰，辐射。反射是由于传输路径上的阻抗不匹配导致；串扰是由于线间距导致；辐射则与高速器件本身以及PCB设计有关。 （1）信号线的阻抗匹配 传输线判断 利用之前判断高速信号的公式，所以对于高速和低速的区分，
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2016-03-10 10:51:23
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