BWM(带宽管理，corePac中的模块，每个corePac有一个BWM)的目的是避免一个请求对一个资源的长期存取而造成的阻塞，BWM确保所有请求者都能获取一定大的带宽资源。
BWM是全局定义（对于整个corePac来说），局部实现（在每一个corePac中实现）。
初始化带宽管理既是设置一系列寄存器（arbitration registers），配置时需要在每个CPU上对同一寄存器设置（即每...
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2014-06-05 10:58:51
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Table 4-1列出来了master与slave的连接。
? Y — 表示master与slave之间有连接（是指通过总线连接master与slave，这里的master与slave没有
跨越不同速率的总线）；
? - — 表示master与slave之间没有连接，即不存在该master对slave的访问；
? n — 表示master与slave之间通过B...
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2014-06-05 02:07:41
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There is no systematic design for shared resource access priority in platform side, and there is no interface provided by
platform that can be used by application to do bandwidth management optimizat...
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2014-06-03 04:54:35
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仲裁寄存器default值：
The default values of CPUARB, IDMAARB, SDMAARB, and UCARB are sufficient for most applications. These registers define priorities that are internal to the C66x CorePac. The MDMAARBU...
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2014-06-03 03:53:28
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The master DMA arbitration control register (MDMAARBU) controls the priority levels of MDMA requests going out of CorePac. It controls the priority levels used by the L2 memory
controller when sendi...
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2014-06-03 02:39:09
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这周从淘宝花了200多买到向往已久的树莓派板子，是英国版『UK』的，想来玩玩手上，特此开贴为记。
SD卡单独买的，32G大小的，感觉8G不够用。没有配显示器，本来就是树莓派当作机器敲。 英国版树莓派配置如下：项目B型 SoC
BroadcomBCM2835（CPU，GPU，DSP和SDRAM...
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2014-05-25 23:49:40
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下图为TI C6xx DSP Nyquist总线拓扑图，总线连接了master与slave，提供了高速的数据传输。有很多种速率不同的总线，如图中的红色方框，最高速总线为CPU/2 TeraNet SCR（即VBUSM SCR），带宽为256bit，其他低速总线为CPU/3，CPU/6，带宽参考图中所示。总线之间用Bridge（桥）连接，作用包括转换总线的速率，使之与所流向总线的速率相同等。
在具...
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2014-05-25 22:42:54
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TI C66x DSP有两种总线，数据总线与配置总线。一些外设有数据与配置总线，然而其他的仅有一种总线接口。总线接口宽度与速度各个外设不一样。配置总线主要用于访问外设的寄存器空间，数据总线主要用于数据的传输。
CPU，EDMA TC,外设等分为两类：master与slave。masters用于发起read与write操作，不依赖于EDMA传输；slaves依赖于master发起的read与wri...
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2014-05-25 10:11:50
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Semaphore module in block diagram of the TI C66x DSP device....
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2014-05-22 22:36:43
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Direct request is the simplest method used to request a semaphore. The request behaves as an atomic read and set operation. The result of a request is either to grant the semaphore
to the requesting...
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2014-05-22 17:21:38
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