The present invention relates to processing of time series data. There is disclosed a method and apparatus for processing time series data, the method...
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2014-07-24 09:54:03
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1 如果FPGA设计中包含不同频率的时钟，就会涉及异步时钟的问题。我们需要一些方法来使得时钟同步，从而保证FPGA设计的可靠性。
2 在建立和保持时间所构成的有效时间窗口内，数据输入到触发器进行转换。如果数据的到达时间不满足建立或者保持时间就会产生时序冲突。此时触发器的输出就有可能停留在非逻辑0 或1 的范围内（这个状态叫做准稳态），从而造成逻辑错误。
3 如果异步时钟的相位不...
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2014-07-23 17:18:32
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3.4 通过AnimationSet应用多个动画 AnimationSet提供了一个把多个动画组合成一个组合的机制，并可设置组中动画的时序关系，如同时播放，顺序播放等。 以下例子同时应用5个动画： 播放anim1；同时播放ani...
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2014-07-22 08:28:37
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最近在用P178G，需要对内部寄存器进行控制，实现各个PHY的开关与VLAN配置，为了替代最初模拟开关实现的“伪”开关，通过ds得知可以使用SMI接口进行读写寄存器，控制IC工作状态。
时序与格式如图：
该芯片前置码与其他很多芯片的32Bit高电平不同，按32bit实现也可以通用。常规SMI各个位域说明如下：
PRE：帧前缀域，为32个“1”比特，这帧前缀域不是须要的，某些物...
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2014-07-22 00:29:38
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本文不是用来讲授入门手把手ABC小例子的，算是自己这段时间对Timer和Quartz使用心得的总结吧，后续如果有更深的认识会不断更新的。? 言归正传，想实现定时调度，最简单的方法是使用Timer? 还是先给个使用范例：...
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2014-07-21 23:27:32
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微处理器与外设交换数据的过程中可以选择一下两种方式并行通信：很多为位一起传输，串行通信：一个位一个位的传输通信的制式 单工 半双工 全双工164芯片接收一个串行数据进来，转为并行的数据输出，属于串转并行真值表假设需要传数据10110011则时序图如下连线表示arm联线到A B端口同时还的连到cloc...
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2014-07-19 11:22:11
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虚拟主机的配置思考问题!http://localhost/news.html http://www.sohu.comhttp://www.taobao.com.cn目前我们是 http://localhost/myblog/需求我希望http://www.shunping.comhttp://www...
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2014-07-18 19:36:41
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前面我们说了如何I2C用户模式驱动，这种驱动基于I2C子系统，但是他对于应用程序开发人员的要求较高，需要应用程序开发人员了解硬件的一些东西，比如时序，地址等等，而多数时候应用程序开发人员是按照操作文件的方法操作设备，所以我们更希望用一些更简单的接口去访问。也就是我们今天的内容——基于I2C子系统.....
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2014-07-18 17:34:26
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FPGA 设计中的流量，时滞，时序
流量：每个时钟周期能够传输的数据位。
时滞：数据从输入到输出需要经历的时钟周期；
时序：两个元件之间的最大延迟，他决定系统的最高时钟速度。
1 采用流水线可以提高 流量；
例如计算X^3,迭代结构
流水线：
此时
流量=8/1
时滞=3
时序=乘法器延迟
2 如果要求低时滞则可以去掉寄存器
3 降低时序，提高...
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2014-07-17 16:31:57
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竞争条件
两个或多个进程读写某些共享数据，而最后的结果取决于进程运行的精确时序，称为竞争条件。凡涉及到资源的共享时就容易发生这样的事情。解决的办法是设立临界区，让进程互斥地访问共享资源。一个好的避免竞争条件的方案，必须满足4个条件：
任何两个进程不能同时处于临界区。不应对CPU的速度和数量做任何假设。临界区外运行的进程不得阻塞其它进程。不得让进程无限期等待进入临界区。
忙...
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2014-07-13 15:52:18
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