【文章摘要】 对于由多个模块协同工作的软件来说，程序处理的时序是非常重要的。当消息处理的顺序出现混乱时，程序就会出现异常。 本文基于作者的实际项目经验，对软件模块之间的时序问题进行了详细的分析，为相关软件问题的分析及解决提供了有益的参考。【关键词】 C语言 时序 模块 开发 消息 一、问题描述 在某软件版本中，有两个模块(模块A与模块B)之间...
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2014-06-27 10:29:36
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作者：张克强 作者微博：张克强-敏捷307序列图，也称时序图、顺序图，英文名Sequence Diagram。在雅各布森用例分析方法中鼓励使用各类图形来表达，但恰恰没有明确提到序列图。而科伯恩用例分析方法以结构化/半结构化文本用例为中心，强调基于目标的文本格式，对UML各类图所提甚少。在RUP和OOAD中，UML序列图的最基本定位是用于识别类与类之间的信息传递，是识别类的方法的最佳场合。它是...
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2014-06-26 07:06:30
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现在是二月，并且到现在你也许已经读到、或听到人们谈论UML 2.0 —— 包含若干进步的 UML 的新规范，所做的变化。考虑到新规范的重要性，我们也正在改动这个文章系列的基础，把我们的注意力从 OMG 的 UML 1.4 规范，转移到 OMG 的已採纳 UML 2.0草案规范（又名 UML 2）。我...
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2014-06-21 08:12:05
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说明 本文源自作者读研期间的一份作业报告，主要基于建立时间、保持时间等时间约束参数推导时序分析公式，并通过实验进行验证。 因时间久远，某些实验数据和理论推导可能存在缺失，且难以回忆。若对读者造成理解困难，还请见谅~ 相关实验参见以下两篇文章： 采用流水线技术实现8位加法器 Stratix内...
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2014-06-15 18:29:16
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OOA面向对象分析 面向对象分析产生三种分析模型 功能模型(即用例模型à作为输入) 对象模型:对用例模型进行分析,把系统分解成互相协作的分析类,通过类图/对象图描述对象/对象的属性/对象间的关系,是系统的静态模型 动态模型:描述系统的动态行为,通过时序图/协作图描述对象的交互,以揭示对象间如何协作来...
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2014-06-14 19:53:25
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第六章 时钟域有一个有趣的现象，众多数字设计特别是与FPGA设计相关的教科书都特别强调整个设计最好采用唯一的时钟域。换句话说，只有一个独立的网络可以驱动一个设计中所有触发器的时钟端口。虽然这样可以简化时序分析以及减少很多与多时钟域有关的问题，但是由于FPG**外各种系统限制，只使用一个时钟常常又不现...
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2014-06-14 18:27:15
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这个实例我们来看看如何对设计进行时序优化，假设设计的顶层框图如图1所示， 该设计在两个系统之间实现了一个POS-PHY第三层链路。图1：POS-PHY顶层设计框图如图所示在POS-PHY第三层接收器模块收到包之后，包检测模块分析一个包里的数据，以确保数据是正确的，比如确保包的长度是1K字，ERR标志...
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2014-06-14 18:01:36
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说明
本文基于FPGA和CPLD器件，采用非流水线和流水线技术实现8位加法器，并对比其Quartus II仿真结果和波形时序。 器件选择：
Stratix：EP1S40F1020C5(FPGA) MAX7000S：EPM7064SLC44-5(CPLD)实验一 FPGA实现8位加法器 程序...
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2014-06-13 20:12:24
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这里简要的讨论 hybrid network 与一些时序数据的分析。hybrid network
指网络中存在离散随机变量与连续随机变量，这种情况下一般非常麻烦，这主要是因为连续型随机变量需要使用某个参数族来进行刻画，某些情况下对应的 margin
却不属于给定的参数族。常用的处理手段是离散化，即将...
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2014-06-08 23:00:42
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