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RTP推流服务器EasyRTMP实现内网摄像头RTSP拉流转码RTMP推流到EasyRTMP-Android音频采集流程是什么?
音视频流媒体硬解码是指不使用CPU进行编码,使用显卡GPU,专用的DSP、FPGA、ASIC芯片等硬件进行编码。编码框架Video ToolBox和AudioToolbox。 EasyRTMP是结合了多种音视频缓存及网络技术的一个rtmp直播推流端,包括:圆形缓冲区(circular buffer) ...
分类:移动开发   时间:2019-11-06 16:57:53    阅读次数:132
简单高效易用Windows/Linux/ARM/Android/iOS平台实现RTMP推送组件EasyRTMP-Android MediaCodec硬编码流程介绍
音视频流媒体硬解码是指不使用CPU进行编码,使用显卡GPU,专用的DSP、FPGA、ASIC芯片等硬件进行编码。编码框架Video ToolBox和AudioToolbox。 EasyRTMP是结合了多种音视频缓存及网络技术的一个rtmp直播推流端,包括:圆形缓冲区(circular buffer) ...
分类:移动开发   时间:2019-11-06 16:54:40    阅读次数:160
玩转zynq7010——FPGA点亮三色灯
本篇文章分享米尔zynq7010开发板试用体验。前期主要以开发Z-TURN的PL部分为主,以期望了解该芯片的逻辑架构和系统总线,以及所有外设,后面在开始PS部分的开发,闲话少说,先看整个7z010的系统框图,所有开发目前基于ISE14.6来设置,在软件中可以看到PL和PS部分的总线连接以及PS和PL的外设资源,根据米尔提供的原理图的,找到控制RGBLED的控制管脚,并编写一个RGBLED闪烁的ve
分类:其他好文   时间:2019-10-22 12:31:47    阅读次数:118
《驱动学习 - Nor Flash驱动》
1.nor硬件介绍: 从原理图中我们能看到NOR FLASH有地址线,有数据线,它和我们的SDRAM接口相似,能直接读取数据,但是不能像SDRAM直接写入数据,需要有命令才行。 ...
分类:其他好文   时间:2019-10-19 14:40:15    阅读次数:79
zynq7020开发板+ Z-turn调试计划
参加米尔zynq7020开发板试用活动。 收到米尔z-turn板子后,焊接了一个JTAG转接板,以方便调试PL部分,对于后面的调试部分,主要分三个部分走:1、调试FPGA部分,实现逻辑控制外围简单的设备,比如点个灯什么的,用Verilog语言实现,后期需要实现外部AD板卡的数据采集,并分析相关逻辑数 ...
分类:其他好文   时间:2019-10-18 19:10:42    阅读次数:97
EasyRTMP+EasyDSS实现一套完整的紧急视频回传直播与存储回放方案之EasyRTMP-iOS的AACEncoder.m文件实现音频的硬编码功能
音视频流媒体硬解码是指不使用CPU进行编码,使用显卡GPU,专用的DSP、FPGA、ASIC芯片等硬件进行编码。编码框架Video ToolBox和AudioToolbox。 EasyRTMP是结合了多种音视频缓存及网络技术的一个rtmp直播推流端,包括:圆形缓冲区(circular buffer) ...
分类:移动开发   时间:2019-10-09 17:33:35    阅读次数:176
读--FPGA设计指导原则
主要内容如下: 面积和速度的平和与互换 硬件原则 系统原则 同步设计原则 乒乓操作 串并转换 流水线操作 数据接口的同步方法 RAM FIFO 1.面积与速度的平衡与互换 这里的面积指一个设计消耗FPGA/CPLD的逻辑资源的数量,对于FPGA可以用消耗的FF(触发器)和LUT(查找表)来衡量,更一 ...
分类:其他好文   时间:2019-10-06 17:05:51    阅读次数:149
001-CORDIC实现除法
2019年10月6日10:07:26 CORDIC除法原理不再赘述: MATLAB(适用条件:除数不能超过被除数的2倍): 对应FPGA实现思路: 1)初始化对应RST复位实现; 2)(frac_down * frac_up) < 0 用异或实现; 3)迭代利用generate + 寄存器组实现,每 ...
分类:其他好文   时间:2019-10-06 13:02:30    阅读次数:313
000-FPGA学习常用资源
一、好的书籍 各个芯片的器件手册 《数字信号处理的FPGA实现》 VERILOG手册:http://www.emmelmann.org/Library/Tutorials/docs/verilog_ref_guide/vlog_ref_top.html 二、好的团体 DIGILENT中文:http: ...
分类:其他好文   时间:2019-10-06 11:37:34    阅读次数:123
基于FPGA的数字秒表设计
硬件平台:DE2-115 软件环境:Quartus II 15.1 采样了较为简单的计数方法,详细代码就不讲解了,分为三个模块,一个是计数模块 count.v,一个是显示模块 disp.v,还有一个是顶层模块 miaobiao.v。有清零按键和暂停拨码开关。 顶层模块: 1 module miaob ...
分类:其他好文   时间:2019-10-06 00:17:56    阅读次数:118
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