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MTK7681——HLK_M35模块调试
模块STA手动配置及收发数据所有的指令都是字符串格式,在字符串末尾需要加‘\r’回车键。1、保证模块电源,地连接正确,供电为3.3V,保证串口连接正确,模块的RX接串口的TX,模块的RX接串口的TX。2、进入AT模式(1)ES/RST引脚拉低2秒,在拉高,使用at指令查询,如果收到应答,..
分类:其他好文   时间:2016-03-24 13:21:52    阅读次数:372
Verilog array for synthsis
integer i,j;always @(posedge i_clk or negedge i_rst_n)begin if(!i_rst_n)begin for(i = 0; i < i_wghtGridH; i = i + 1)begin for(j = 0; j < i_wghtGridW;
分类:其他好文   时间:2016-03-15 18:40:23    阅读次数:129
UVa 10603 Fill [暴力枚举、路径搜索]
10603 Fill There are three jugs with a volume of a, b and c liters. (a, b, and c are positive integers not greater than 200). The rst and the second j
分类:其他好文   时间:2016-03-11 20:38:30    阅读次数:184
verilog 状态机键盘扫描
module key (clk,rst,key_up,led);input clk,rst,key_up;output reg [3:0] led;parameter T10ms=31'd2_000_00;reg clk_state;reg [31:0] cnt;parameter state_in
分类:其他好文   时间:2016-03-08 23:10:36    阅读次数:262
第二天所有程序
/* { int a,b,rst,c; scanf("%d,%d,%d",&a,&b,&c); switch(c) { case 1: rst=a+b;printf("%d\n",rst);break; case 2: rst=a-b;printf("%d\n",rst);break; case 3
分类:其他好文   时间:2016-02-17 20:54:38    阅读次数:305
asyn_fifo
1 //Module Name:afifo_ctrl 2 //Description:parameterized afifo 3 4 module afifo_ctrl( 5 clk_push, 6 rst_push_n, 7 clk_pop, 8 rst_pop_n, 9 push, 10 pus
分类:其他好文   时间:2016-02-01 23:48:41    阅读次数:311
progress 相关事件 异步 ajax
loadstart — Fires when the ? rst byte of the response has been received.progress — Fires repeatedly as a response is being received.error — Fires when
分类:Web程序   时间:2016-01-28 17:05:02    阅读次数:174
[转载]Tutorial: Todo-List 应用
本文转载自: https://github.com/myzhan/bottle-doc-zh-cn/blob/master/docs/tutorial_app.rst Note 这份教程是 noisefloor 编写的,并在不断完善中。 这份教程简单介绍了Bottle框架,目的是让你看完后能在项目中
分类:其他好文   时间:2016-01-27 17:16:02    阅读次数:226
TCP连接的建立与关闭
TCP是主机对主机层的传输控制协议:建立连接要三个握手,断开连接要四次挥手。位码即TCP标志位,有6种标示:SYN(synchronous建立联机),ACK(acknowledgement 确认),PSH(push传送),FIN(finish结束),RST(reset重置),URG(urgent紧急...
分类:其他好文   时间:2016-01-25 19:37:05    阅读次数:137
FPGA时钟分频(转)
http://www.cnblogs.com/fpga/archive/2009/10/24/1589318.html占空比为50%的分频偶数分频比较简单比如N分频,那么计数到N/2-1,然后时钟翻转,代码如下:1moduleeven(clk_in,clk_out,rst_n);2inputclk_...
分类:其他好文   时间:2016-01-17 18:51:42    阅读次数:143
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