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搜索关键字:nand    ( 587个结果
图像的基本有损压缩和无损压缩及解压
关键词:5-5-5,5-6-5,游长编码优化,图像压缩、解压 背景有损量化这里介绍从8-8-8到5-5-5和5-6-5的量化压缩原理及其编程实现。无损压缩这里我基于游长编码算法(利用像素的重复)提出一...
分类:其他好文   时间:2016-11-17 20:45:54    阅读次数:419
fdisk -c 0 350 1000 300命令
在Linux中有一个fdisk的分区命令,在对开发板的nand或者emmc分区也会用到这个命令, fdisk -c 0 350 1000 300 这里0 350 1000 300分别代表: 每个扇区大小为0,一共350个柱面,起始柱面是1000,扇区数量为300 其中: ...
分类:其他好文   时间:2016-11-09 11:39:05    阅读次数:666
嵌入式Linux驱动学习之路(二十三)NAND FLASH驱动程序
NAND FLASH是一个存储芯片。 在芯片上的DATA0~DATA7上既能传输数据也能传输地址。 当ALE为高电平时传输的是地址。 当CLE为高电平时传输的是命令。 当ALE和CLE都为低电平时传输的是数据。 将数据发给nand Flash后,在发送第二次数据之前还要判断芯片是否处于空闲状态。一般 ...
分类:系统相关   时间:2016-11-08 01:15:05    阅读次数:258
Verilog HDL的不同抽象级别1
用门级结构描述D触发器,实例如下: 由已经设计好的模块构成更高一级的模块,用触发器组成代清零端的4位寄存器代码和实验结果如下: module flop(data,clock,clear,q,qb);input data,clock,clear;output q,qb; nand #10 nd1(a, ...
分类:其他好文   时间:2016-11-04 22:51:09    阅读次数:348
ECCV 2016 paper list
摘录ECCV2016部分文章,主要有Human pose esimation, Human activiity / actions, Face alignment, Face detection & recognition & .. , Hand tracking, Eye, and Others. ...
分类:其他好文   时间:2016-10-23 23:08:30    阅读次数:707
Tiny6410之NAND FLASH驱动
一、NAND FLASH的特点 S3C6410的NAND FLASH控制器有如下特点 1、自导入模式:复位后,引导代码被送入到8KB的STEPPINGSTONE中,引导代码移动完毕,引导代码将在STEPPINGSTONE中执行。导入期间,NAND FLASH控制器不支持ECC矫正。 2、NAND F ...
分类:其他好文   时间:2016-10-22 20:34:03    阅读次数:284
2016 CCPC 东北地区重现赛
1、 2016 CCPC 东北地区重现赛 2、总结:弱渣,只做出01、03、05水题 08 HDU5929 Basic Data Structure 模拟,双端队列 1、题意:模拟一个栈的操作,并在每次询问时,计算栈项到栈底元素nand位运算的值。 2、总结:思路就是看距离栈底最近的0的后面1的个数 ...
分类:其他好文   时间:2016-10-17 20:48:33    阅读次数:172
01-布尔逻辑的习题
一,基础芯片的实现:使用Nand门,构建基本芯片1,使用Nand门实现Not门 (1)原理: Not(a) = Nand(a,a) (2) 描述: 芯片名:Not 输入:a 输出:out 功能:if a=0 out=1 else out=0 (3)实现: CHIP Not{ IN in; OUT o ...
分类:其他好文   时间:2016-10-15 16:17:15    阅读次数:135
[HDOJ5929]Basic Data Structure(双向队列,规律)
题目链接:http://acm.hdu.edu.cn/showproblem.php?pid=5929 题意:维护一个栈,支持往栈里塞 0/1 ,弹栈顶,翻转栈,询问从栈底到栈顶按顺序 NAND 的值。 题解:只要知道最后的 00 后面 11 的个数的奇偶性就行。可以用链表把所有 00 的位置存下来 ...
分类:其他好文   时间:2016-10-07 01:08:57    阅读次数:151
Verilog门级建模
门级建模就是将逻辑电路图用HDL规定的文本语言表示出来,即调用Verilog语言中内置的基本门级元件描述逻辑图中的元件以及元件之间的连接关系。 Verilog语言内置了12个基本门级元件模型,如下表所示。门级元件的输出、输入必须为线网类型的变量。 1.多输入门 and、nand、or、nor、xor ...
分类:其他好文   时间:2016-10-06 13:02:18    阅读次数:138
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