1：激活orCAD与Allegro的交互程序打开原理图，Options->Preference在Miscellaneous里勾选2：打开用到的工程 原理图，还有Allegro PCB Design。在Allegro PCB Design里要激活Place->Manually命令，此时用鼠标左键选中o...
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2015-05-12 15:24:51
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Cadence 16.5开始，打开原理图工具 Orcad Capture 时，总是会弹出startpage 页面，关闭它的方法：解决方法如下：(1) View---Toolbar----Command Window(2)输入以下命令： SetOptionBool EnableStartPage 0 ...
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2015-05-12 15:09:09
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1.打开OrCAD Capture然后可以新建工程，也可以直接建library①简单的元器件建立第一个框是器件大小框添加表框添加链接端口更改端口属性放置管脚矩阵②复合原件的创建创建选项创建A部分上下两根连接线为power取消吸附点键盘end键为刷新点此回到原位置；我们做的是A部分，下面做B部分Ctr...
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2015-03-20 20:14:34
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PCB(Printed Circuit Board）设计软件经过多年的发展、不断地修改和完善，或优存劣汰、或收购兼并、或强强联合，现在只剩下Cadence和Mentor两家公司独大。 Cadence公司的推出的SPB(Silicon Package Board)系列，原理图工具采用Orcad C.....
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2015-03-06 19:03:35
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如果运行Capture.exe找不到cdn_sfl401as.dll，如果运行allegro.exe找不到cnlib.dll，（上面俩个库文件都在C:/Cadence/SPB_16.3/tools/bin中），请检查环境变量设置是否完整！我遇到上述问题，发现没有CDSROOT的定义，添加一个： .....
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2015-01-16 18:57:08
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之前用Multisim做运放电路仿真时发现运放输出大于电源轨的现象，有时想拿运放当比较器做开环仿真，但在multisim中的仿真结果居然是线性放大，而且输出超过电源电压，非常郁闷，因此之后仿真都是用Cadence 的orcad/Pspice来仿真。不过画个频率响应都要用公式来绘图，信号比较多，操作不...
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2014-12-03 23:02:32
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PSpice A/D9.1个别时候可能会出现异常现象，例如：某一步后，突然电路图的电源极性被自动改变了！造成直流电压和直流电流不正常，输出无波形。所以应该趁正常的时候做好备份是明智的。PSpice A/D9.1没有提供变压器仿真，但是可以用一个磁芯和3只电感来模拟。PSpice A/D9.2提供了变...
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2014-10-21 21:26:14
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Sigrity提供了丰富的千兆比特信号与电源网络分析技术，包括面向系统、印刷电路板(PCB)和IC封装设计的独特的考虑电源影响的信号完整性分析功能。Sigrity分析技术与CadenceAllegro和OrCAD设计工具的组合将会提供全面的前端到后端的综合流程，帮助系统和半导体公司提供高性能设备..
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2014-10-11 01:45:35
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Sigrity提供了丰富的千兆比特信号与电源网络分析技术，包括面向系统、印刷电路板(PCB)和IC封装设计的独特的考虑电源影响的信号完整性分析功能。Sigrity分析技术与Cadence Allegro和OrCAD设计工具的组合将会提供全面的前端到后端的综合流程，帮助系统和半导体公司提供高性能设备，...
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2014-10-10 22:46:04
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激活OrCAD与Allegro的交互程序1. 打开原题图，Options->Preference在Miscellaneous里勾选2. 同时打开OrCAD原理图设计界面及Allegro PCB Design界面。在Allegro PCB Design里要激活Place->Manually命令，此时用...
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2014-10-08 09:16:04
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