整合PetaLinux工程编译和Open Source U- Boot/Linux编译 整合PetaLinux工程编译和Open Source U- Boot/Linux编译 整合PetaLinux工程编译和Open Source U- Boot/Linux编译 整合PetaLinux工程编译和Op ...
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2019-10-31 16:43:18
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今年3月，Intel公布了牵头开发的CXL开放互连技术，服务于下一代高性能计算、数据中心，底层基于PCIe，可消除CPU与设备、CPU与存储之间的计算密集型工作负载的传输瓶颈，显著提升性能。 随后，几家巨头开始筹备组成CXL联盟，并先后吸纳了IBM、赛灵思(Xilinx)、AMD、ARM等行业巨头加 ...
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2019-10-04 09:17:06
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引用：https://www.cnblogs.com/YangGuangPu/p/11478487.html 最近在把Quartus Prime 15.1的工程移植到Vivado 2019.1，需要改变的地方还是很多的，先记一下差分信号在FPGA中的收发管脚定义和配置。以LVDS信号为例吧。 在7 ...
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2019-09-12 19:47:49
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MZ7020 CD 链接：http://pan.baidu.com/s/1dER3fyx 密码：2j7c 最新原理图：链接：https://pan.baidu.com/s/1esOYqC05r7MfD07WwqiqWg 提取码：0kr5 Vivado_SDK_2015.4 链接：https://pa ...
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2019-09-11 17:49:01
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最近在把Quartus Prime 15.1的工程移植到Vivado 2019.1，需要改变的地方还是很多的，先记一下差分信号在FPGA中的收发管脚定义和配置。以LVDS信号为例吧。 在7 Series FPGA & ZYNQ-7000 All Programmable SoC Library Gu ...
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2019-09-06 23:10:54
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拿到Z-turnBoard开发板后，第一时间在论坛求助该板子对JTAG下载器的要求，经查找资料，发现xilinx的下载器通用于所有的xilinx芯片，固还是最终在淘宝买了一个JTAG下载器，不得不说，xilinx的下载器真心贵！130多。。。拿到JTAG第一件事情就是看看该下载器能否识别芯片，好啦，先上图，打开设备管理器后的界面如图1所示，Y2a5a6i,color_FFFFFF,t_100,g_
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2019-08-08 16:18:24
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将错误窗口关闭， 双击Boundary Scan，跳出窗口”Do you want to continue and ...”直接关闭， 再跳出一个窗口“This device supports attached Flash PROM .....“窗口再直接关闭，再点击图示的SPI/BPI接口添加.m ...
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2019-07-28 17:43:37
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早就听闻XILINX新一代SOC，ZynqUltraScale+MPSOC系列性能强悍无比，号称相比ZYNQ7000系列每瓦性能提升5倍，一直未能体验一把。直到近期因项目需要，入手了一套米尔的MPSOC开发板，才终于开启了MPSOC学习之路。废话不说，helloworld先。开发环境：vivado2017.4，开发板型号：米尔MYD-CZU3EG，主芯片XCZU3EG-1SFVC784。这个MPS
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2019-07-24 09:51:11
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需要在上电USB枚举过程中通过fxload下载固件到USB Cable，然后重新枚举加载驱动。系统需要安装fxload工具，在Xilinx Vivado/ISE安装目录下找到固件文件xusb*.hex复制到/usr/share下，然后创建如下udev rules文件。 # Xilinx USB Ca ...
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2019-07-05 00:21:03
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第一步：使用WinDriver生成驱动 1.运行Drier Wizard 2.点击New host driverproject 3.在列表中，选择待安装驱动的设备，这里选择基于PCI的Xilinx数据采集卡 4.点击Generate .INF file控件 5.在弹出的口中，可以看到待安装驱动的设备 ...
