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【Verilog】组合逻辑写法

时间:2018-06-07 10:26:33      阅读:161      评论:0      收藏:0      [点我收藏+]

标签:input   image   选择   输入   inpu   info   图片   bsp   bubuko   

 

下面是四选一多路选择器。有两类input信号,输入信号 in[3:0] ,选择信号 s[1:0]。

s选定后,in更新,out跟着更新,所以in必须写入敏感列表。

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【Verilog】组合逻辑写法

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原文地址:https://www.cnblogs.com/kevinchase/p/9149072.html

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